Programmerò fpga e farò design rtl usando verilog vhdl systemverilog

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Ingegnere FPGA Verilog VHDL RTL Vivado Quartus SoC

Ingegnere FPGA ed elettronico con oltre 4 anni di esperienza in Verilog, VHDL e design RTL su Xilinx Vivado e Intel Quartus. Mi specializzo nel co-design hardware-software Zynq SoC usando MATLAB/Simul...
Informazioni su questo servizio

Se cerchi un ingegnere FPGA affidabile per progettare, debugare o ottimizzare il tuo progetto FPGA, sono la persona giusta. Sono un ingegnere FPGA e RTL con esperienza con oltre 4 anni di esperienza pratica nello sviluppo di Verilog e VHDL. Offro supporto completo per FPGA, dalla codifica RTL alla sintesi, chiusura dei tempi e debug hardware usando Xilinx Vivado o Intel Quartus.


Cosa posso fare per te:

  • Progettazione RTL FPGA in Verilog / VHDL / SystemVerilog
  • Progettazione e ottimizzazione di sistemi di base FPGA
  • FSM, controller digitali, ALU, contatori e pipeline
  • Integrazione IP basata su AXI4-Lite / AXI-Stream
  • Chiusura dei tempi e ottimizzazione delle risorse
  • Sviluppo di core IP personalizzati
  • Debug di progetti FPGA esistenti


Simulazione & Verifica:

  • ModelSim / Vivado Simulator / QuestaSim
  • Creazione di testbench e debug delle waveform


SoC & FPGA embedded:

  • Xilinx Zynq (integrazione PS-PL)
  • Vitis / Xilinx SDK
  • MicroBlaze / Nios II
  • Supporto embedded HDL + C/C++


Perché scegliermi?

  • RTL pulito e ben documentato
  • Comunicazione rapida
  • Esperienza pratica nel settore
  • Supporto al 100% fino al completamento del progetto


Contattami prima di effettuare un ordine, così possiamo discutere chiaramente i requisiti del tuo progetto.


Piattaforma:

FPGA

Sensori:

Temperatura

•

Umidità

•

Accelerometro

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Ultrasonic

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Microfono

Expertise:

Sviluppo firmware

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RTOS

•

Debug

•

Ottimizzazione SoC

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