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Scriverò moduli e testbench Verilog, SystemVerilog o VHDL per FPGA
Servizi di Ingegneria Elettrica da uno studente TUe MSc specializzato in RF, FPGA,
Offro:
• Script Python/MATLAB per l'elaborazione del segnale — filtri, FFT, analisi spettrale, pipeline di dati
• Moduli Verilog/VHDL e testbench — progettazione RTL, verifica, correzioni di bug
• Rev...
Informazioni su questo servizio
Hai bisogno di Verilog, SystemVerilog o VHDL per il tuo progetto FPGA? Progetto RTL pulito e sintetizzabile con verifica adeguata.
FAQ
Traduzione automatica.
Quali FPGA supporti?
Scrivo per Xilinx, Intel/Altera e Lattice. Indica il tuo target e garantirò la compatibilità.
Fornisci file di simulazione?
Sì, ogni consegna include un testbench e istruzioni per eseguire la simulazione.
Puoi sistemare o ottimizzare codice esistente?
Assolutamente. Condividi il tuo codice e descrivi il problema — diagnosticherò e lo fixerò.
Che dire di sintesi e timing?
I pacchetti Standard/Premium includono report di sintesi. Posso ottimizzare per il timing se necessario.
Fai sistemi FPGA completi?
Mi concentro su moduli individuali o piccoli sottosistemi. Per progetti SoC di grandi dimensioni, discutiamone prima lo scope.
Puoi aiutare con testbench cocotb?
Sì! Scrivo testbench cocotb basati su Python per verifiche più complesse.
