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Svilupperò il tuo progetto xilinx fpga usando vivado e vitis
Sviluppatore FPGA e AI con 8 anni di esperienza in Verilog VHDL HLS
Sono un ingegnere FPGA e hardware digitale con oltre 8 anni di esperienza pratica nella progettazione RTL, debug, verifica, ottimizzazione e accelerazione hardware. Lavoro con Verilog, VHDL, SystemVer...
Livello 1
Ha soddisfatto determinati criteri di prestazione e mostra un forte potenziale nel marketplace.
Informazioni su questo servizio
Hai bisogno di aiuto per sviluppare un progetto FPGA Xilinx con Vivado o Vitis? Posso aiutarti a trasformare i tuoi requisiti di design in una implementazione FPGA funzionante.
Svilupperò, integrerò, debuggherò e ottimizzerò progetti FPGA AMD Xilinx usando Vivado, Vitis, Verilog, VHDL e SystemVerilog.
Posso lavorare con:
- progetti Vivado e Block Design
- Zynq e ZynqMP
- interfacce AXI e IP personalizzati
- integrazione software Vitis
- sviluppo RTL e integrazione IP
- vincoli XDC
- simulazione e verifica
- sintesi e implementazione
- analisi di timing e risorse
- generazione del bitstream
- co-design hardware/software
Posso lavorare con progetti esistenti o sviluppare una soluzione partendo dai tuoi requisiti.
Il mio workflow: Requisiti -> Design -> Implementazione -> Simulazione -> Sintesi -> Timing -> Verifica
Per favore, inviami la parte/board FPGA, versione di Vivado/Vitis, file di progetto esistenti e requisiti prima di ordinare.
Per progetti complessi di Zynq, ZynqMP o hardware personalizzato, contattami per un'offerta su misura.
Piattaforma:
FPGA
Il mio portfolio
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FAQ
Traduzione automatica.
Puoi lavorare sul mio progetto Vivado esistente?
Sì. Posso modificare, debug, integrare, ottimizzare o estendere un progetto Vivado esistente. Per favore, fornisci i file del progetto e spiega le modifiche necessarie.
Lavori con Zynq e ZynqMP?
Sì. Posso lavorare su sistemi Zynq e ZynqMP, inclusi Vivado Block Design, interfacce AXI, IP personalizzati, integrazione hardware/software e Vitis.
Puoi sviluppare IP AXI personalizzati?
Sì. Posso sviluppare e integrare IP RTL personalizzati e collegarli a un sistema di elaborazione Zynq/ZynqMP usando le interfacce AXI appropriate.
Puoi usare Vitis?
Sì. Posso integrare il design hardware FPGA con Vitis per co-design hardware/software, inclusa la comunicazione tra il processore e la logica FPGA.
Puoi lavorare con la mia scheda FPGA Xilinx specifica?
Di solito, sì. Per favore, fornisci il numero di modello esatto del FPGA/SoC o della scheda di sviluppo prima di ordinare, così posso confermare la compatibilità.
Puoi generare il bitstream finale?
Sì. Quando i file hardware necessari, i vincoli, gli IP e le versioni degli strumenti sono disponibili, posso sintetizzare, implementare e generare il bitstream FPGA.
Puoi risolvere errori di Vivado o problemi di timing?
Sì. Posso indagare su errori di sintesi, errori di implementazione, violazioni di timing, problemi di vincoli, utilizzo delle risorse e altri problemi di sviluppo FPGA.
Devo ordinare direttamente?
Per compiti piccoli e chiaramente definiti, puoi ordinare il pacchetto appropriato. Per progetti complessi di FPGA, Zynq/ZynqMP, Vitis o hardware/software, contattami prima così posso rivedere i requisiti e fornirti l'offerta personalizzata corretta.
Recensioni
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A andrewbynoe
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Do a good job . would work with this gig again.
600 USD-800 USD
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