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18 anni di esperienza nella ricerca e sviluppo hardware (HW R&D).
Esperienza approfondita in elaborazione di segnali ad alta velocità, riduzione del rumore di alimentazione, progettazione di affidabilità del prodotto.
Competente in layout PCB con PADS e Allegro.
Esperto in simulazioni di signal integrity e power integrity, utilizzo qualificato di Hyperlynx e Cadence Sigrity (per simulazioni PCIe Gen4 e DDR4).
Vasta esperienza in FPGA, con competenze in progettazione con Xilinx, Altera e Lattice.